采用智能时钟门控技术降低动态开关功耗

时钟门控是一种广为人知的功耗优化方法常用于ASIC 和FPGA设计, 这种方法可减少不必要的开关操作。该方法通常需要设计人员在代码中添加少量逻辑来禁用或取消选择没必要保持使能的顺序组件, 例如寄存器。尽管通过该方法降低动态功耗的效果明显, 但设计人员在手动进行优化时往往面临巨大挑战 ●若要真正减少设计中不必要的活动, 只有对设计本身有着深人的了解, 而且通常需要对RT L进行大量修改。 ●目前大多数ASIC 和FPGA设计都整合了最新的、传统的以及第三方IP 电路设计, 但是通常只有最新的设计方案才应用时钟门控优化。设计人员几乎从不对传统的和第三方IP 设计进行时钟门控优化。他们通