FPGA实现时钟显示(Verilog HDL语言)
利用Verilog HDL语言编写数字逻辑,最终将程序下载到FPGA开发板上,用LED显示时钟信息。
用户评论
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不是verilog写的不过写的还算不错
asd56558 2020-08-16 03:44:43
不是verilog语言写的，是vhdl写的，quartus软件