Coo1Runner II器件I2C接口协议
这里将说明I2C的主要通信协议,更详细的说明和时序图请参考I2C规范文档。 I2C总线包括两个信号线,即SDA和SCL。所有通信都发生在这两个信号线上,连接到同一条总线上的设备数目受限于最大的总线电容。SDA和SCL都是双向的,通过上拉电阻连接到系统电源。总线空闲时,这两个总线保持高电平。在总线上的I2C设备的输出数据阶段,必须是漏极开路或是集电极开路以实现线与功能。 每个设备都有唯一的地址,可以工作在发送模式或接收状态,也可以被配置为主设备或从设务。方设备启动一次总线数据传输,并产生时钟信号,总线上任何其他设备都会被视为从设备。I2C协议同时还具有仲裁机制,如果多台主设备同时申请控制总线
用户评论
相关推荐
Coo1Runner II器件实现IDE总线接口和协议
IDE接口有两个工作模式,即PIO模式和DMA模式。当IDE设备的状态寄存器BSY位被清零并且DRQ位被置“1”时,进行PIO数据传输,PIO模式数据位通常为16位。片选信号CS0和CSI选择设各命令
PDF
131KB
2020-11-18 01:02
Coo1Runner II器件实现地址解码总线接口逻辑
如图所示为8051的总线状态机。 如图 8051的总线状态机 首先,8051将地址送上地址总线。当ALE_N有效时,状态机转入ADDR DECODE状态。开始对地址进行解码,并判断当前CPLD
PDF
68KB
2020-11-17 20:18
Coo1Runner II器件实现8051微控制器接口
通过8051接口读/写CPLD内的寄存器,从而完成对SPI的控制。8051与SPI控制器之间通过寄存器连接,因此通过修改8051接口逻辑可以使其方便地与其他处理器连接。 来源:ks99
PDF
25KB
2020-11-17 23:12
Coo1Runner II器件实现功能描述
I2C总线是一个通用的串行总线,仅有两个信号线,分别是SCL(时钟)和SDA(数据)。每一个连接到总线上的设备,无论是主设备还是从设备,均可以通过软件寻址。而且对于每一个设备,这个地址是惟一的。
PDF
75KB
2021-04-04 19:41
Coo1Runner II器件实现CPU接口和寄存器模块
此接口实现CPU对CPLD寄存器的访问,CPLD与PXA270的静态存储器接口相连,工作在16位VLIO模式下。此接口工作在104 MHz(CPU时钟),CPU片选、写使能和读使能信号被用来解码CPU
PDF
28KB
2020-11-18 03:03
Coo1Runner II器件实现SPI寄存器
SPI寄存器基地址由VHDL代码中BASE ADDRESS常数决定,低4位决定了具体的寄存器地址。这些值都可以在VHDL代码中修改,以适应不同的系统。 来源:ks99
PDF
23KB
2020-11-17 20:13
Coo1Runner II器件实现CPLD寄存器
(1)模式寄存器:定义DE控制器工作模式。 (2)命令地址寄存器:选择控制块和命令块寄存器。 (3)PIO读/写数据寄存器:保存IDE读/写数据。 (4)命令寄存器:指定IDE总线上的读/写操作
PDF
26KB
2020-11-17 23:27
Coo1Runner II器件实现SCK时钟发生逻辑
此进程为SCK输出,逻辑,SCK与控制寄存器的CLKDIV、CPHA和CPOL位有关。SCK INT是内部SCK,用其来控制串行数据输出,是SPI控制状态机的同步时钟。当CPHA=1时,SCK_OUT
PDF
70KB
2021-03-25 03:09
Coo1Runner II器件实现功能描述系统图
NAND Flash存储器接口控制器的功能如下。 (1)NAND接口 NAND Flash是一种低成本、高性能且高密度非易失性存储器,被广泛地应用于MP3、MP4、PMP及数码相机等产品中。
PDF
408KB
2021-03-25 03:09
Coo1Runner II器件实现SRAM控制器
DMA传输时,16位的SRAM用来存储来自CPU/IDE的数据。SRAM分为两个块,分别是Buffer1(0x00~0xff)和Buffer2(0x100~Oxlff)。 如图所示为SRAM控制器状
PDF
306KB
2020-11-17 20:38
CoolRunner II器件的I2C接口主状态机
I2C接口主状态机如图所示。 如图 I2C接口主状态机 无论是主模式,还是从模式,状态机都是相同的。在每个状态,模式都会被检测,以决定输出和下一个状态。如果仲裁失败或 I2C控制器被确定为从模
PDF
90KB
2020-11-17 22:36
Coo1Runner II器件实现双向多路选择器
该范例的设计与实现如下。 (1)CPLD设计 CPLD设计实际上是一个双向多路选择器,主机通过“Select”信号选择SD卡。一旦选中,CPLD会自动检测数据流的方向并建立通信。不必用专门的引
PDF
245KB
2020-11-17 23:54
EDA PLD中的Coo1Runner II器件实现功能描述
I2C总线是一个通用的串行总线,仅有两个信号线,分别是SCL(时钟)和SDA(数据)。每一个连接到总线上的设备,无论是主设备还是从设备,均可以通过软件寻址。而且对于每一个设备,这个地址是惟一的。
PDF
71KB
2020-11-17 20:07
Coo1Runner II器件实现设计范例IDE控制器
IDE控制器的CoolRunner-II实现支持以下功能。 (1)Intel PXA270 CPU的16位VLIO模式下的静态存储器接口。 (2)ATA PIO模式0。 (3)用做缓存的外部SR
PDF
29KB
2020-11-17 20:13
Coo1Runner II器件实现SPI接收寄存器SPIRR
SPIRR保存从MISO接收到的数据,当从SPI总线接收到一个字节并保存到SPIRR寄存器中时,RCV_FULL标志有效,8051就可以读取SPIRR数据。 来源:ks99
PDF
24KB
2020-11-17 23:43